75
70
65
60
55
51 76
80
85
90
95
100 gnd v dd( nc 50
45
40
35
30
26 1
5
10
15
20
25 nc nc gnd gnd nc v dd nc nc gnd nc nc nc nc gnd v dd gnd v dd gnd gnd nc nc nc nc nc nc 1
2
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23
24
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i
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rst
v dd
gnd
sysio0
sysio1
sysio2
sysio3
sysio4
sysio5
sysio6
sysio7
stat1
ccs
gnd
stat0
strb
cadrs1
cadrs2
cadrs3
cadrs4
cadrs5
cadrs6
cadrs7
sysf 26
27
28
29
30
31
32
33
34
35
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39
40
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47
48
49
50 o
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nc
nc
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dout2
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dout6
dout7
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nc
nc
nc
nc
pcerd 51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
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69
70
71
72
73
74
75 o
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o
o
i
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i
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i
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o
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o swdet
nc
v dd
gnd
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apdep2
aden2
aint2
nc
gnd
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suop0
suip1
suip0
nc
nc
tp4
tp3
tp2
tp1 76
77
78
79
80
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89
90
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94
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98
99
100 o
i
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i
i
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i
i
i
i
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i
i
i
i
i
? ? ? i tp0
test
v dd
gnd
ck
sopmd
cifmd
nc
nc
din0
din1
din2
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gnd
din5
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prtyi
nc
nc
nc
refh pin
no. i/o signal pin
no. i/o signal pin
no. i/o signal pin
no. i/o signal CXD8969AR (1/2)
il08d c-mos sddi interface (gate array)
?op view
CXD8969AR (2/2) input
apdep0 - apdep2
cadrs1 - cadrs7
ccs
cifmd
ck
din0 - din9
oenbl
prtyi
reff
refh
rst
sopmd
stat0, stat1
strb
suip0, suip1
test
output
aden0 - aden2
aint0 - aint2
dout0 - dout9
pcerd
prtyo
suop0, suop1
swdet
sysf
sysh
sysv
tp0 - tp4
input/output
sysio0 - sysio7
; ch-0, 1, 2 data end
; address
; chip select
; cpu i/f mode setting
; system clock
; parallel data
; din0 - din9 output enable
; din0 - din9 parity
; reference frame
; reference h
; system reset
; tx /rx mode setting
; bus status 0, 1
; strobe
; input port 0, 1
; test for ic (gnd connect)
; ch-0, 1, 2 data enable
; ch-0, 1, 2 interrupt
; parallel data
; payload crcc error detect
; dout0 - dout9 parity
; output port 0, 1
; switching detect
; reference frame
; reference h
; v blanking
; test point 0 - 4
; data bus
|